1樓：網友
這個問題很可能是時序的問題，有以下兩個可能：
1、fpga的輸出方向，輸出延時output delay在有無signal tap ii時發生變化，造成mii時鐘和資料的相位關係改變，或者說開始對方晶元時鐘可以採到正確的資料，但output delay變化後時鐘採不到正確的資料。
2、時脈頻率約束。增加mii時脈頻率約束。由於mii的冊梁拍時鐘僅為25m，現在絕大多數fpga可以輕鬆超過這個頻率，所以這個因素可能性不大。
另外可以試州羨試quartus ii的設定：
assignment —>settings —>compilation proecess settings —>渣手。
勾選 perform physical synthesis on combinational logic
perform register duplication
2樓：網友
你好，能問你一下關於mii介面的問題嗎？我現在在做fpga 的udp的通訊。跡悉這個mii management 如何判斷上乙個 operation已經結束了呢？
operation 比如read或迅局者write或者scan status等畝州讓。
rmii和和mii的區別
3樓：匿名使用者
修改u-boot 主要是已經驅動函式中關於rmii模式的選擇。譬如定義巨集config_driver_ti_emac_use_rmii 以及pinmux的修改 mii模式和rmii模式的引腳是不一樣的。還有驅動函式的修改。
dp83848的mii位址怎麼設定
4樓：匿名使用者
檢查stm32的mac時鐘是否已開啟。 檢查乙太網50m的時鐘是否正確配置。 檢查stm32的乙太網複用io是否連線到重對映埠上。
檢查stm32的乙太網rmii埠是否已正確初始化，io埠的時鐘是否已開啟。 檢查連線dp83848的rst引腳的io是否已初始化。
cpu的mii介面與交換晶元ip175c 能夠直接連線嗎？如何連線？
5樓：網友
哥們，現在實現了嗎，我也要用這種方式連線，不知道怎麼弄。。。可以聯絡一下嗎。
正在學習用fpga做mii介面程式，phy晶元是lan8710a。可否乙個非常完整的例子？非常感謝。
6樓：網友
上有完整的mii例子，很不錯～
想通過串列埠除錯助手傳送資料，通過232串列埠給fpga以改變程式中的乙個引數，如何實現？大家幫幫忙啊。
7樓：網友
1、硬體上fpga板肯定要有rs232介面與pc連線才行，沒有的話，一切免談。
2、軟體上寫乙個串列埠接收模組，設定好波特率和資料位寬。
就這兩點東西。
我有驗證過的串列埠verilog程式，可直接拿去用。
8樓：網友
還沒有整出來，把電腦發給fpga的資料放到乙個暫存器裡，再用暫存器裡的資料用作分頻係數。就實現了。
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