如何檢視ise ip核的verilog**
1樓：網友
生成ip核後在相應工程資料夾下找到ip資料夾，裡面的。v檔案就是其**。
2樓：網友
生成ip核之後，選擇生成的ip核，在processes視窗中選擇view hdl function model
fpga 使用內部 ram ip核 的方法，麻煩會的朋友吧那個幫忙。。。謝謝
3樓：網友
你選擇的是分散式ram，讀寫資料速度快，但是容量比較小；塊ram讀寫速度慢一些，但容量比較大。
在圖中，你選擇了雙口ram的形式，雙口ram可以有兩個讀寫位址，兩個資料輸出埠，塊ram時也可以採用不同的時鐘。options中，depth表示儲存資料深度，即資料個數；data width表示儲存資料位寬，即資料範圍和精度。埠含義如下：
1、a表示寫入位址，同時也是第乙個輸出埠(spo)的讀取位址，其資料位數與定義的depth對應；
2、d表示寫入的資料，其資料位數與定義的data width對應；
3、dpra表示第二個輸出埠(dpo)的讀取位址；
4、we為寫使能訊號，高電平有效，可以寫入資料；
5、clk為讀寫時鐘；
6、其它訊號帶rst為各種復位訊號；帶ce的為各種使能訊號；首字母為q的是暫存器輸出訊號（q本身含有d觸發器輸出的意思），即讀出資料與讀取位址相應的延遲乙個時鐘週期。
各個訊號的含義多試試看看時序波形就清楚了，而且也有相應的英文說明，樓主多多努力，學無止境哈！
4樓：網友
我只用過xilinx的，非常好用！幾年前的事情了，稍微回憶一下供參考。
選擇雙口ram，寬度和深度配置好了以後，應該會自動生成乙個配置檔案和一段**，把**拷貝到你的程式裡，埠配好就可以用了。
幫助裡面什麼都有，要有信心！
5樓：網友
spa是b口的輸出位址 這些很簡單的啊。
6樓：網友
ram ip core的用法很多，在知道上三言兩語很難說清楚。
看到**下方偏左部位的「datasheet」按鈕了沒？點選這裡可以開啟ip核對應的詳細說明文件，這裡面的資訊是最詳盡準確的。
求乙個在xilinx ise中呼叫 fft ip核來計算1024點fft的verilog程式，輸入的資料存放在rom核中。
7樓：網友
這個事ip核的呼叫，你可以參看datasheet,上面有時序圖，如果你這樣子提問，大家是不好幫助你的，datasheet上面可以配置不同的模式。
fpga中用了ise中ip核，乙個單口ram,但只有乙個wea寫使能端，想問下，如果想要從這個ram中讀資料怎麼辦？
8樓：袖結清風楚舞妍
我用的是altera下的，不過原理應該都一樣吧，altera的單口ram，有乙個wren使能，如果為1則是寫ram，為0則是讀ram，也就是說，你要麼讀要麼寫，不寫的時候就讀，只要不改變位址，輸出的值就不變，不會對系統產生影響，所以一般情況下，如果不寫，那麼就把wren置0，也就是一直處於讀狀態。這個是altera下的，我沒有用過ise的，但是感覺原理應該一樣。
求xilinx ise fft ip core的呼叫程式，用vhdl語言實現。以及如何** 測試。十分感謝！！！
9樓：匿名使用者
我記得這本書裡面有寫 好像有電子版的。
呼叫xilinx 的乘累加器ip核，然後進行**，得到的波形與預期的不一樣，如何解決？
10樓：27樓是
樓主你解決了沒？我也被這個困擾了，我用chipscope也抓不到輸出。這麼簡單的核，實在不明白**能配置錯。
11樓：匿名使用者
你的波形顯示怎麼是有符號顯示？是你自己故意設定的有符號嗎？一般是無符號吧？你設定成無符號顯示，看看滿足不滿足你的要求。
12樓：網友
這方面的資料太少了。。
xilinx fpga中pci ip核如何使用
13樓：秒劍
暑假的機會，為了參加省賽學了段fpga，寫些自己的看法，希望對你有幫助。
國內關於fpga的書vhdl多，不過如改，一渣廳判般工程師都是用verilog，其實沒必要非要是xilinx的書，xilinx的工具軟體會使用後，也就是**的不同了，ise的使用你可以在 文庫 去找教程，有很多。
xilinx的sopc教程可能國內的資料少些。
對於你說的要在fpga裡邊綜合出51的核，個人感覺這樣做沒什麼意義，我試著綜合過，佔用很多slics，而且埠處理比較囉嗦，有些浪費資源。51核綜合的話網上有很多介紹很詳細。
1、這裡提供非常多，非常好的pld了核心，8051核心就可以在裡面找到。
2、 我個人比較喜歡。
另外自己也收集了些資料，留個郵箱我伏陸傳給你。
演算法方面，最近新出來的**無論是altera的還是xilinx的， 內部都有整合了dsp核、arm核的。
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