1樓：匿名使用者
lut中存放的是邏輯表示式x的真值表，圖中程式設計級從左至右存放的是dcba=0000~1111這16種輸入時的x輸出值。
你可以先寫出x表示式的真值表，輸入是dcba，輸出是x，就可以看出lut中的存放規律了。
2樓：匿名使用者
abcd控制mux的輸出，你仔細看選擇器上的兩個輸入埠上有0 1的標誌，代表選擇訊號是1時，輸出1下面的訊號，0也同樣如此。這樣你順著路徑看，就知道符合這個公式了。把具體值代入，就得到了紅色的路徑。
3樓：匿名使用者
說明白一點，其實lz給的圖中所有的邏輯元器件是不存在的，只是一個形象比方而已。
lut實際就是一個地址解碼器，輸入對應著相對應的地址，比如輸入dcba=1111，那麼解碼輸出就是1，也就是x輸出函式的最後一項。那麼就用一個ram就解決了所有實際邏輯電路，大大節省了使用transistor的數目。
然而這個函式x的簡化實現是通過程式設計軟體簡化計算後得到的結果，不是通過現實的邏輯電路做出來的。
4樓：匿名使用者
舉個例子裡說：如何用4輸入lut實現表示式x。就是推測eeprom中的值，你可以畫出x的對應真值表，應該不難。如圖所示：
如果a=1，b=1，c=0，d=0那麼x=1，以此類推，a,b,c,d控制門控開關，讓其選通相應的函式值到x端。
當然知道了eeprom的值，你也可以對應填到真值表中，然後通過化簡卡諾圖，這樣可以反推它實現的功能！即對應查詢表對應的邏輯表示式，這一點如果你去參加邏輯工程師的面試，可能會遇到。
fpga中怎麼建立查詢表兩路輸入一路輸出
5樓：浺凝鈴軒靈
1.查詢表（look-up-table)簡稱為lut，lut本質上就是一個ram。目前fpga中多使用4輸入的lut，所以每一個lut可以看成一個有4位地址線的16x1的ram。
當使用者通過原理圖或hdl語言描述了一個邏輯電路以後，pld/fpga開發軟體會自動計算邏輯電路的所有可能的結果，並把結果事先寫入ram,這樣，每輸入一個訊號進行邏輯運算就等於輸入一個地址進行查表，找出地址對應的內容，然後輸出即可。 2.①cpld更適合完成各種演算法和組合邏輯,fpga更適合於完成時序邏輯。
換句話說,fpga更適合於觸發器豐富的結構,而cpld更適合於觸發器有限而乘積項豐富的結構。 ②cpld的連續式佈線結構決定了它的時序延遲是均勻的和可**的,而fpga的分段式佈線結構決定了其延遲的不可**性。 ③在程式設計上fpga比cpld具有更大的靈活性。
cpld通過修改具有固定內連電路的邏輯功能來程式設計,fpga主要通過改變內部連線的佈線來程式設計;fpga可在邏輯閘下程式設計,而cpld是在邏輯塊下程式設計。 ④fpga的整合度比cpld高,具有更復雜的佈線結構和邏輯實現。 ⑤cpld比fpga使用起來更方便。
cpld的程式設計採用e2prom或fastflash技術,無需外部儲存器晶片,使用簡單。而fpga的程式設計資訊需存放在外部儲存器上,使用方法複雜。 ⑥cpld的速度比fpga快,並且具有較大的時間可**性。
這是由於fpga是門級程式設計,並且clb之間採用分散式互聯,而cpld是邏輯塊級程式設計,並且其邏輯塊之間的互聯是集總式的。 ⑦在程式設計方式上,cpld主要是基於e2prom或flash儲存器程式設計,程式設計次數可達1萬次,優點是系統斷電時程式設計資訊也不丟失。
請問一下fpga的lut到底是如何實現邏輯功能的。
6樓：匿名使用者
lut是通過查表方式實現的，一個四輸入的lut就是一個16位的ram，因為四輸入的訊號最多隻有16種組合，每一種組合對應一種輸出，就像給這個ram一個地址一樣。所以xilinx的四輸入lut是可以配置成一個16位的ram的，所謂分散式ram就是拿一些lut組合成你所需大小的ram。這種儲存器適合小塊的ram，是對block ram的一個很好補充。
7樓：匿名使用者
軟體會計算邏輯**，可以理解為對映成一張真值表~~把真值表直接放到lut裡面去~~lut實際上也可以看做是ram~~~兩與門和一個或門，比如a&b|c，那麼是三輸入一個輸出，放到一個四輸入lut裡面足夠了~~
8樓：匿名使用者
我說下我的理解，lut實際上是ram結構，4輸入實際是地址線，如果要實現與門組合邏輯，我們有兩種做法：
1、用電晶體搭建與門結構電路，實現邏輯。
2、把真值表列出來11--1,10--0,01--0,00--0；然後對於lut把輸入11,10,01,00作為地址線，把1,0,0,0作為地址所對應的ram儲存空間的值，即11的地址所對應的儲存空間存1,10的地址所對應的儲存空間存0.……外部電路輸入的訊號接到lut的地址線，對應的儲存空間接到輸出線，這樣我們就用純查詢結構模擬了一個與門。
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